Vitis使用教程图解说明：调试器设置与断点使用技巧

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Vitis调试器不是“暂停键”，而是你和FPGA之间的翻译官

去年在做一款实时雷达信号处理加速卡时，我们遇到一个诡异问题：PS端Linux驱动每次提交第7帧DMA请求后，PL侧Conv核输出就错一位——不是全乱，只是高位字节偏移。用ILA抓了上百次波形，信号看起来完全正常；GDB单步跟到Xil_DCacheInvalidateRange()也没发现异常；最后靠在AXI地址总线上手动插了一个set_input_delay -max 0.1约束才解决。那一刻我意识到：Vitis调试器真正的价值，从来不是“让程序停下来”，而是帮你听懂硬件在说什么。

这正是本文想讲清楚的事：Vitis调试器不是Eclipse套了个壳，它是Xilinx为异构系统量身打造的一套软硬语义对齐工具链。它把ARM指令、AXI协议、HLS变量名、ILA触发条件这些原本分属不同抽象层的语言，翻译成你能理解的同一套逻辑。下面我们就从一次真实的调试现场出发，拆解这套“翻译机制”是怎么工作的。